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Implementación de filtros digitales sobre FPGA usando Vivado HLS

Resumen en español

Este trabajo de grado tiene como objetivo la implementación de filtros digitales sobre un sistema de desarrollo ZedBoard, usando el entorno de desarrollo Vivado High Level Synthesis (HLS). El aporte principal de este trabajo es la realización de un tutorial sobre la implementación de algoritmos de procesamiento digital de señales sobre FPGA. Específicamente se realizó la implementación de filtros FIR para señales unidimensionales. Las implementaciones se realizaron sobre señales de frecuencia modulada lineal, también conocida como Chirp, que es una onda sinusoidal simple que aumenta su frecuencia con el tiempo, permitiendo hacer un análisis fácil del funcionamiento del filtro implementado debido a que podemos ver el resultado de la aplicación del filtro también en el dominio del tiempo.